Datata access works for fixed base address
This commit is contained in:
@@ -30,7 +30,7 @@ NGDBUILD Design Results Summary:
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Number of errors: 0
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Number of errors: 0
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Number of warnings: 1
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Number of warnings: 1
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Total memory usage is 4418716 kilobytes
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Total memory usage is 4418744 kilobytes
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Writing NGD file "LAN_IDE_CP.ngd" ...
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Writing NGD file "LAN_IDE_CP.ngd" ...
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Total REAL time to NGDBUILD completion: 5 sec
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Total REAL time to NGDBUILD completion: 5 sec
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@@ -58,3 +58,23 @@ cpldfit -intstyle ise -p xc95288xl-10-TQ144 -ofmt vhdl -optimize speed -loc on -
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xst -intstyle ise -ifn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.xst" -ofn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.syr"
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xst -intstyle ise -ifn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.xst" -ofn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.syr"
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ngdbuild -intstyle ise -dd _ngo -uc pinlist.ucf -p xc95288xl-TQ144-10 LAN_IDE_CP.ngc LAN_IDE_CP.ngd
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ngdbuild -intstyle ise -dd _ngo -uc pinlist.ucf -p xc95288xl-TQ144-10 LAN_IDE_CP.ngc LAN_IDE_CP.ngd
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cpldfit -intstyle ise -p xc95288xl-10-TQ144 -ofmt vhdl -optimize speed -loc on -slew fast -init low -inputs 54 -pterms 25 -unused float -power std -terminate keeper LAN_IDE_CP.ngd
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cpldfit -intstyle ise -p xc95288xl-10-TQ144 -ofmt vhdl -optimize speed -loc on -slew fast -init low -inputs 54 -pterms 25 -unused float -power std -terminate keeper LAN_IDE_CP.ngd
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xst -intstyle ise -ifn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.xst" -ofn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.syr"
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ngdbuild -intstyle ise -dd _ngo -uc pinlist.ucf -p xc95288xl-TQ144-10 LAN_IDE_CP.ngc LAN_IDE_CP.ngd
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cpldfit -intstyle ise -p xc95288xl-10-TQ144 -ofmt vhdl -optimize speed -loc on -slew fast -init low -inputs 54 -pterms 25 -unused float -power std -terminate keeper LAN_IDE_CP.ngd
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xst -intstyle ise -ifn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.xst" -ofn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.syr"
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ngdbuild -intstyle ise -dd _ngo -uc pinlist.ucf -p xc95288xl-TQ144-10 LAN_IDE_CP.ngc LAN_IDE_CP.ngd
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cpldfit -intstyle ise -p xc95288xl-10-TQ144 -ofmt vhdl -optimize speed -loc on -slew fast -init low -inputs 54 -pterms 25 -unused float -power std -terminate keeper LAN_IDE_CP.ngd
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xst -intstyle ise -ifn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.xst" -ofn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.syr"
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ngdbuild -intstyle ise -dd _ngo -uc pinlist.ucf -p xc95288xl-TQ144-10 LAN_IDE_CP.ngc LAN_IDE_CP.ngd
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cpldfit -intstyle ise -p xc95288xl-10-TQ144 -ofmt vhdl -optimize speed -loc on -slew fast -init low -inputs 54 -pterms 25 -unused float -power std -terminate keeper LAN_IDE_CP.ngd
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tsim -intstyle ise LAN_IDE_CP LAN_IDE_CP.nga
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hprep6 -s IEEE1149 -n LAN_IDE_CP -i LAN_IDE_CP
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xst -intstyle ise -ifn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.xst" -ofn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.syr"
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ngdbuild -intstyle ise -dd _ngo -uc pinlist.ucf -p xc95288xl-TQ144-10 LAN_IDE_CP.ngc LAN_IDE_CP.ngd
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cpldfit -intstyle ise -p xc95288xl-10-TQ144 -ofmt vhdl -optimize speed -loc on -slew fast -init low -inputs 54 -pterms 25 -unused float -power std -terminate keeper LAN_IDE_CP.ngd
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xst -intstyle ise -ifn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.xst" -ofn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.syr"
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ngdbuild -intstyle ise -dd _ngo -uc pinlist.ucf -p xc95288xl-TQ144-10 LAN_IDE_CP.ngc LAN_IDE_CP.ngd
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cpldfit -intstyle ise -p xc95288xl-10-TQ144 -ofmt vhdl -optimize speed -loc on -slew fast -init low -inputs 54 -pterms 25 -unused float -power std -terminate keeper LAN_IDE_CP.ngd
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xst -intstyle ise -ifn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.xst" -ofn "C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.syr"
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ngdbuild -intstyle ise -dd _ngo -uc pinlist.ucf -p xc95288xl-TQ144-10 LAN_IDE_CP.ngc LAN_IDE_CP.ngd
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cpldfit -intstyle ise -p xc95288xl-10-TQ144 -ofmt vhdl -optimize speed -loc on -slew fast -init low -inputs 54 -pterms 25 -unused float -power std -terminate keeper LAN_IDE_CP.ngd
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@@ -118,77 +118,76 @@ A<23> S:PIN86
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PARTITION FB1_5 D_5_IOBUFE D_4_IOBUFE
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PARTITION FB1_5 D_5_IOBUFE D_4_IOBUFE
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PARTITION FB1_8 ROM_B_0_OBUF$BUF5
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PARTITION FB1_8 ROM_B_0_OBUF$BUF5
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PARTITION FB1_10 ROM_B_0_OBUF$BUF4
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PARTITION FB1_10 ROM_B_0_OBUF$BUF4
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PARTITION FB1_12 ROM_B_0_OBUF$BUF8 N0$BUF7/N0$BUF7_TRST ROM_B_0_OBUF$BUF6 ROM_B_0_OBUF$BUF7
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PARTITION FB1_12 ROM_B_0_OBUF$BUF8
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autoconfig ROM_B_0_OBUF$BUF3 Z3_ADR<10>
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PARTITION FB1_14 ROM_B_0_OBUF$BUF6 ROM_B_0_OBUF$BUF7
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PARTITION FB2_1 LAN_IRQ_D0 A_LAN_4_OBUF A_LAN_7_OBUF Dout1<7>
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PARTITION FB1_17 ROM_B_0_OBUF$BUF3 autoconfig
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A_LAN_6_OBUF N0$BUF5 Dout1<3> N0$BUF3
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PARTITION FB2_1 LAN_SM_RST A_LAN_4_OBUF A_LAN_7_OBUF LAN_A_INIT<3>
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Dout1<0> D_6_IOBUFE D_9_IOBUFE/D_9_IOBUFE_TRST D_3_IOBUFE
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A_LAN_6_OBUF N0$BUF5 $OpTx$FX_DC$22 N0$BUF3
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DQ_9_IOBUFE/DQ_9_IOBUFE_TRST D_7_IOBUFE D_1_IOBUFE LAN_INT_ENABLE
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$OpTx$FX_DC$19 D_6_IOBUFE SHUT_UP D_3_IOBUFE
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D_8_IOBUFE LAN_IRQ_OUT
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D_9_IOBUFE/D_9_IOBUFE_TRST D_7_IOBUFE D_1_IOBUFE DQ_9_IOBUFE/DQ_9_IOBUFE_TRST
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D_8_IOBUFE AUTO_CONFIG_DONE_CYCLE
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PARTITION FB3_2 ROM_B_0_OBUF$BUF2
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PARTITION FB3_2 ROM_B_0_OBUF$BUF2
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PARTITION FB3_14 N0$BUF6 EXP22_ EXP23_ $OpTx$INV$5
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PARTITION FB3_14 N0$BUF6
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EXP24_
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PARTITION FB3_18 lan_adr
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PARTITION FB4_1 $OpTx$INV$4 D_0_IOBUFE SHUT_UP LAN_D_INIT<1>
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PARTITION FB4_1 lan_adr/lan_adr_RSTF D_0_IOBUFE LAN_WR_RST LAN_SM_FSM_FFd4
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A_LAN_1_OBUF A_LAN_0_OBUF LAN_A_INIT<6> A_LAN_3_OBUF
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A_LAN_1_OBUF A_LAN_0_OBUF LAN_RST_SM_FSM_FFd1 A_LAN_3_OBUF
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||||||
LAN_BASEADR<9> LAN_BASEADR<8> LAN_BASEADR<15> A_LAN_2_OBUF
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LAN_D_INIT<8> LAN_D_INIT<1> LAN_CS_RST A_LAN_2_OBUF
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LAN_BASEADR<12> A_LAN_5_OBUF LAN_BASEADR<11> LAN_BASEADR<10>
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LAN_A_INIT<6> A_LAN_5_OBUF $OpTx$FX_DC$7 LAN_RST_SM_FSM_FFd3
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LAN_BASEADR<0> EXP25_
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LAN_RST_SM_FSM_FFd2 DQ_DATA<11>
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PARTITION FB5_1 LAN_SM_FSM_FFd6 ROM_B_0_OBUF$BUF11 LAN_SM_FSM_FFd5 LAN_SM_FSM_FFd2
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PARTITION FB5_2 ROM_B_0_OBUF$BUF11
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ROM_B_0_OBUF $OpTx$FX_DC$8 $OpTx$FX_DC$7 $OpTx$FX_DC$34
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PARTITION FB5_5 ROM_B_0_OBUF Z3_DS/Z3_DS_D2 LAN_SM_FSM_FFd9 LAN_SM_FSM_FFd6
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LAN_SM_FSM_FFd8 D_2_IOBUFE LAN_SM_FSM_FFd7 D_9_IOBUFE
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LAN_SM_FSM_FFd2 D_2_IOBUFE LAN_SM_FSM_FFd8 D_9_IOBUFE
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||||||
LAN_SM_FSM_FFd3 D_10_IOBUFE D_11_IOBUFE LAN_SM_FSM_FFd10
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LAN_SM_FSM_FFd7 D_10_IOBUFE D_11_IOBUFE LAN_RD_S
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D_12_IOBUFE LAN_RD_S
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D_12_IOBUFE Z3_A_LOW
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PARTITION FB6_1 $OpTx$FX_DC$6 N0$BUF4 A_LAN_12_OBUF $OpTx$FX_DC$41
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PARTITION FB6_2 N0$BUF4 A_LAN_12_OBUF
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A_LAN_13_OBUF A_LAN_10_OBUF $OpTx$FX_DC$36 A_LAN_11_OBUF
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PARTITION FB6_5 A_LAN_13_OBUF A_LAN_10_OBUF
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||||||
$OpTx$FX_DC$26 A_LAN_8_OBUF LAN_SM_FSM_FFd1 lan_adr
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PARTITION FB6_8 A_LAN_11_OBUF
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Z3_ADR<13> A_LAN_9_OBUF Z3_ADR<12> Z3_ADR<11>
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PARTITION FB6_10 A_LAN_8_OBUF
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LAN_WRL_S dq_swap
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PARTITION FB6_14 A_LAN_9_OBUF $OpTx$FX_DC$18 LAN_INT_ENABLE LAN_IRQ_OUT
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DQ_DATA<9>
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PARTITION FB7_3 D_13_IOBUFE
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PARTITION FB7_3 D_13_IOBUFE
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||||||
PARTITION FB7_5 D_14_IOBUFE
|
PARTITION FB7_5 D_14_IOBUFE
|
||||||
PARTITION FB7_9 BUF_LAN_SM_RST LAN_WR_RST LAN_RST_SM_FSM_FFd1 D_15_IOBUFE
|
PARTITION FB7_12 D_15_IOBUFE
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||||||
LAN_D_INIT<8> LAN_CS_RST LAN_WRH_S LAN_RST_SM_FSM_FFd3
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PARTITION FB7_15 LAN_IRQ_D0 DQ_DATA<14> DQ_DATA<13> DQ_DATA<12>
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LAN_RST_SM_FSM_FFd2 DQ_DATA<3>
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||||||
PARTITION FB8_1 EXP26_ DQ_12_IOBUFE DQ_14_IOBUFE
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||||||
PARTITION FB8_5 LAN_WRH_OBUF
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||||||
PARTITION FB8_8 LAN_CS_OBUF LAN_A_INIT<3> LAN_RD_OBUF $OpTx$FX_SC$43
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$OpTx$FX_DC$38 LAN_SM_FSM_FFd9 LAN_SM_FSM_FFd12 LAN_SM_FSM_FFd11
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LAN_BASEADR<1> DQ_DATA<9> DQ_DATA<1>
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||||||
PARTITION FB9_1 DQ_DATA<4> EXP27_
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PARTITION FB9_11 Z3_DATA<0> EXP28_ DQ_DATA<5> Z3_DATA<1>
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EXP29_ DQ_DATA<13> Z3_DATA<2> DQ_DATA<12>
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PARTITION FB10_1 $OpTx$FX_DC$17 DQ_1_IOBUFE DQ_0_IOBUFE AUTO_CONFIG_DONE_CYCLE
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PARTITION FB8_2 DQ_12_IOBUFE DQ_14_IOBUFE
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||||||
DQ_3_IOBUFE DQ_2_IOBUFE Dout1<2> DQ_5_IOBUFE
|
PARTITION FB8_5 LAN_WRH_OBUF
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||||||
LAN_BASEADR<14> DQ_4_IOBUFE DQ_7_IOBUFE DQ_6_IOBUFE
|
PARTITION FB8_8 LAN_CS_OBUF
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|
PARTITION FB8_10 LAN_RD_OBUF
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||||||
|
PARTITION FB8_13 $OpTx$FX_DC$14 LAN_SM_FSM_FFd5 LAN_SM_FSM_FFd1 lan_rdy
|
||||||
|
Z3_DATA<16> LAN_SM_FSM_FFd3
|
||||||
|
PARTITION FB9_11 Z3_DATA<0> Z3_ADR<13> Z3_ADR<12> Z3_DATA<1>
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DQ_DATA<8> DQ_DATA<7> Z3_DATA<2> DQ_DATA<6>
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||||||
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||||||
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PARTITION FB10_1 Dout1<7> DQ_1_IOBUFE DQ_0_IOBUFE Dout1<3>
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||||||
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DQ_3_IOBUFE DQ_2_IOBUFE Dout1<0> DQ_5_IOBUFE
|
||||||
|
Dout1<2> DQ_4_IOBUFE DQ_7_IOBUFE DQ_6_IOBUFE
|
||||||
Dout1<6> DQ_8_IOBUFE Dout1<5> Dout1<4>
|
Dout1<6> DQ_8_IOBUFE Dout1<5> Dout1<4>
|
||||||
DQ_10_IOBUFE Dout1<1>
|
DQ_10_IOBUFE Dout1<1>
|
||||||
PARTITION FB11_2 BUF_LAN_SM_FSM_FFd9 Z3_DATA<3> $OpTx$FX_DC$35 Z3_DATA<4>
|
PARTITION FB11_1 Z3_DATA<31> Z3_DATA<30> Z3_DATA<3> Z3_DATA<29>
|
||||||
Z3_DATA<31> Z3_DATA<30> Z3_DATA<29> Z3_DATA<23>
|
Z3_DATA<4> Z3_DATA<28> Z3_DATA<23> Z3_DATA<22>
|
||||||
Z3_DATA<5> Z3_DATA<6> ROM_B_0_OBUF$BUF1 Z3_DATA<22>
|
Z3_DATA<21> Z3_DATA<5> Z3_DATA<6> ROM_B_0_OBUF$BUF1
|
||||||
ROM_B_0_OBUF$BUF0 Z3_DATA<21> DQ_DATA<8> ROM_B_0_OBUF$BUF9
|
Z3_DATA<20> ROM_B_0_OBUF$BUF0 Z3_DATA<19> Z3_DATA<18>
|
||||||
DQ_DATA<0>
|
ROM_B_0_OBUF$BUF9 Z3_DATA<17>
|
||||||
PARTITION FB12_2 N0$BUF2
|
PARTITION FB12_2 N0$BUF2
|
||||||
PARTITION FB12_5 DQ_15_IOBUFE
|
PARTITION FB12_5 DQ_15_IOBUFE $OpTx$FX_DC$4 Z3_ADR_1 DQ_13_IOBUFE
|
||||||
PARTITION FB12_7 lan_adr/lan_adr_RSTF DQ_13_IOBUFE LAN_BASEADR<7> DQ_11_IOBUFE
|
Z3_ADR_0 DQ_11_IOBUFE Z3_ADR<6> DQ_9_IOBUFE
|
||||||
LAN_BASEADR<6> DQ_9_IOBUFE LAN_BASEADR<5> LAN_BASEADR<4>
|
Z3_ADR<5> Z3_ADR<4> Z3_ADR<3> Z3_ADR<2>
|
||||||
LAN_BASEADR<3> LAN_BASEADR<2> LAN_BASEADR<13> BUF_lan_adr
|
LAN_WRL_S LAN_WRH_S
|
||||||
|
PARTITION FB13_2 ROM_B_0_OBUF$BUF10
|
||||||
PARTITION FB13_1 LAN_SM_RST ROM_B_0_OBUF$BUF10
|
|
||||||
PARTITION FB13_8 Z3_DATA<7>
|
PARTITION FB13_8 Z3_DATA<7>
|
||||||
PARTITION FB13_13 LAN_SM_FSM_FFd4 LAN_WRL_OBUF DQ_DATA<7> DQ_DATA<6>
|
PARTITION FB13_13 Z3_ADR<8> LAN_WRL_OBUF Z3_ADR<7> DQ_DATA<2>
|
||||||
DQ_DATA<15> DQ_DATA<14>
|
DQ_DATA<1> DQ_DATA<15>
|
||||||
PARTITION FB14_3 N0$BUF0
|
PARTITION FB14_3 N0$BUF0
|
||||||
PARTITION FB14_5 $OpTx$FX_DC$19 Z3_ADR_1 Z3_ADR_0 Z3_ADR<9>
|
PARTITION FB14_11 CFOUT_OBUF
|
||||||
Z3_ADR<8> Z3_ADR<7> CFOUT_OBUF Z3_ADR<6>
|
PARTITION FB14_14 SLAVE_OBUF N0
|
||||||
Z3_ADR<5> SLAVE_OBUF N0 Z3_ADR<4>
|
PARTITION FB14_18 N0$BUF7/N0$BUF7_TRST
|
||||||
Z3_ADR<3> Z3_ADR<2>
|
PARTITION FB15_9 Z3_ADR<9> Z3_ADR<11> Z3_ADR<10> N0$BUF7
|
||||||
PARTITION FB15_1 DQ_DATA<11> EXP30_
|
DQ_DATA<5> Z3_DATA<15> Z3_DATA<14> DQ_DATA<4>
|
||||||
PARTITION FB15_12 N0$BUF7 DQ_DATA<2> Z3_DATA<15> Z3_DATA<14>
|
Z3_DATA<13> DQ_DATA<3>
|
||||||
|
PARTITION FB16_1 BUF_LAN_SM_FSM_FFd9 Z3_DATA<12> Z3_DATA<11> $OpTx$FX_SC$29
|
||||||
PARTITION FB15_17 Z3_DATA<13> DQ_DATA<10>
|
$OpTx$FX_DC$25 Z3_DATA<10> LAN_SM_FSM_FFd12 Z3_DATA<9>
|
||||||
PARTITION FB16_1 lan_rdy Z3_DATA<12> Z3_DATA<11> Z3_DATA<28>
|
LAN_SM_FSM_FFd11 N0$BUF1 Z3_DATA<8> Z3_DATA<27>
|
||||||
Z3_DATA<27> Z3_DATA<10> Z3_DATA<26> Z3_DATA<9>
|
Z3_DATA<26> Z3_DATA<25> Z3_DATA<24> LAN_SM_FSM_FFd10
|
||||||
Z3_DATA<25> N0$BUF1 Z3_DATA<8> Z3_DATA<24>
|
DQ_DATA<10> DQ_DATA<0>
|
||||||
Z3_DATA<20> Z3_DATA<19> Z3_DATA<18> Z3_DATA<17>
|
|
||||||
Z3_DATA<16> Z3_A_LOW
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+931
-931
File diff suppressed because it is too large
Load Diff
+882
-1493
File diff suppressed because it is too large
Load Diff
File diff suppressed because one or more lines are too long
File diff suppressed because one or more lines are too long
File diff suppressed because one or more lines are too long
File diff suppressed because one or more lines are too long
@@ -1,7 +1,7 @@
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Release 8.1i - Fit P.20131013
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Release 8.1i - Fit P.20131013
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Copyright(c) 1995-2003 Xilinx Inc. All rights reserved
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Copyright(c) 1995-2003 Xilinx Inc. All rights reserved
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12-17-2018 10:59PM
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12-17-2018 11:55PM
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NOTE: This file is designed to be imported into a spreadsheet program
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NOTE: This file is designed to be imported into a spreadsheet program
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such as Microsoft Excel for viewing, printing and sorting. The pipe '|'
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such as Microsoft Excel for viewing, printing and sorting. The pipe '|'
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File diff suppressed because one or more lines are too long
+862
-1201
File diff suppressed because it is too large
Load Diff
@@ -3,13 +3,13 @@ Copyright (c) 1995-2013 Xilinx, Inc. All rights reserved.
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--> Parameter TMPDIR set to xst/projnav.tmp
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--> Parameter TMPDIR set to xst/projnav.tmp
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Total REAL time to Xst completion: 1.00 secs
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Total REAL time to Xst completion: 0.00 secs
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Total CPU time to Xst completion: 0.13 secs
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Total CPU time to Xst completion: 0.13 secs
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--> Parameter xsthdpdir set to xst
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--> Parameter xsthdpdir set to xst
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Total REAL time to Xst completion: 1.00 secs
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Total REAL time to Xst completion: 0.00 secs
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Total CPU time to Xst completion: 0.13 secs
|
Total CPU time to Xst completion: 0.13 secs
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||||||
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--> Reading design: LAN_IDE_CP.prj
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--> Reading design: LAN_IDE_CP.prj
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@@ -116,6 +116,8 @@ WARNING:Xst:647 - Input <CP_IRQ> is never used. This port will be preserved and
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WARNING:Xst:2565 - Inout <A<1>> is never assigned.
|
WARNING:Xst:2565 - Inout <A<1>> is never assigned.
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||||||
WARNING:Xst:647 - Input <MTCR> is never used. This port will be preserved and left unconnected if it belongs to a top-level block or it belongs to a sub-block and the hierarchy of this sub-block is preserved.
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WARNING:Xst:647 - Input <MTCR> is never used. This port will be preserved and left unconnected if it belongs to a top-level block or it belongs to a sub-block and the hierarchy of this sub-block is preserved.
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WARNING:Xst:647 - Input <C1> is never used. This port will be preserved and left unconnected if it belongs to a top-level block or it belongs to a sub-block and the hierarchy of this sub-block is preserved.
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WARNING:Xst:647 - Input <C1> is never used. This port will be preserved and left unconnected if it belongs to a top-level block or it belongs to a sub-block and the hierarchy of this sub-block is preserved.
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WARNING:Xst:646 - Signal <dq_swap> is assigned but never used. This unconnected signal will be trimmed during the optimization process.
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WARNING:Xst:646 - Signal <LAN_BASEADR> is assigned but never used. This unconnected signal will be trimmed during the optimization process.
|
||||||
INFO:Xst:1799 - State start_read_upper is never reached in FSM <LAN_SM>.
|
INFO:Xst:1799 - State start_read_upper is never reached in FSM <LAN_SM>.
|
||||||
Found finite state machine <FSM_0> for signal <LAN_SM>.
|
Found finite state machine <FSM_0> for signal <LAN_SM>.
|
||||||
-----------------------------------------------------------------------
|
-----------------------------------------------------------------------
|
||||||
@@ -175,12 +177,8 @@ INFO:Xst:1799 - State start_read_upper is never reached in FSM <LAN_SM>.
|
|||||||
Found 1-bit register for signal <autoconfig>.
|
Found 1-bit register for signal <autoconfig>.
|
||||||
Found 8-bit register for signal <Dout1>.
|
Found 8-bit register for signal <Dout1>.
|
||||||
Found 16-bit register for signal <DQ_DATA>.
|
Found 16-bit register for signal <DQ_DATA>.
|
||||||
Found 1-bit register for signal <dq_swap>.
|
|
||||||
Found 16-bit comparator equal for signal <dq_swap$cmp_eq0000> created at line 247.
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|
||||||
Found 2-bit comparator less for signal <dq_swap$cmp_lt0000> created at line 248.
|
|
||||||
Found 14-bit register for signal <LAN_A_INIT>.
|
Found 14-bit register for signal <LAN_A_INIT>.
|
||||||
Found 1-bit register for signal <lan_adr>.
|
Found 1-bit register for signal <lan_adr>.
|
||||||
Found 16-bit register for signal <LAN_BASEADR>.
|
|
||||||
Found 1-bit register for signal <LAN_CS_RST>.
|
Found 1-bit register for signal <LAN_CS_RST>.
|
||||||
Found 16-bit register for signal <LAN_D_INIT>.
|
Found 16-bit register for signal <LAN_D_INIT>.
|
||||||
Found 1-bit register for signal <LAN_INT_ENABLE>.
|
Found 1-bit register for signal <LAN_INT_ENABLE>.
|
||||||
@@ -199,8 +197,7 @@ INFO:Xst:1799 - State start_read_upper is never reached in FSM <LAN_SM>.
|
|||||||
Summary:
|
Summary:
|
||||||
inferred 2 Finite State Machine(s).
|
inferred 2 Finite State Machine(s).
|
||||||
inferred 1 ROM(s).
|
inferred 1 ROM(s).
|
||||||
inferred 48 D-type flip-flop(s).
|
inferred 47 D-type flip-flop(s).
|
||||||
inferred 2 Comparator(s).
|
|
||||||
inferred 57 Tristate(s).
|
inferred 57 Tristate(s).
|
||||||
Unit <LAN_IDE_CP> synthesized.
|
Unit <LAN_IDE_CP> synthesized.
|
||||||
|
|
||||||
@@ -211,14 +208,11 @@ HDL Synthesis Report
|
|||||||
Macro Statistics
|
Macro Statistics
|
||||||
# ROMs : 1
|
# ROMs : 1
|
||||||
16x8-bit ROM : 1
|
16x8-bit ROM : 1
|
||||||
# Registers : 55
|
# Registers : 53
|
||||||
1-bit register : 49
|
1-bit register : 48
|
||||||
14-bit register : 2
|
14-bit register : 2
|
||||||
16-bit register : 3
|
16-bit register : 2
|
||||||
8-bit register : 1
|
8-bit register : 1
|
||||||
# Comparators : 2
|
|
||||||
16-bit comparator equal : 1
|
|
||||||
2-bit comparator less : 1
|
|
||||||
# Tristates : 27
|
# Tristates : 27
|
||||||
1-bit tristate buffer : 25
|
1-bit tristate buffer : 25
|
||||||
16-bit tristate buffer : 2
|
16-bit tristate buffer : 2
|
||||||
@@ -292,10 +286,8 @@ Macro Statistics
|
|||||||
# FSMs : 2
|
# FSMs : 2
|
||||||
# ROMs : 1
|
# ROMs : 1
|
||||||
16x8-bit ROM : 1
|
16x8-bit ROM : 1
|
||||||
# Registers : 48
|
# Registers : 47
|
||||||
Flip-Flops : 48
|
Flip-Flops : 47
|
||||||
# Comparators : 1
|
|
||||||
16-bit comparator equal : 1
|
|
||||||
|
|
||||||
=========================================================================
|
=========================================================================
|
||||||
|
|
||||||
@@ -386,25 +378,25 @@ Design Statistics
|
|||||||
# IOs : 116
|
# IOs : 116
|
||||||
|
|
||||||
Cell Usage :
|
Cell Usage :
|
||||||
# BELS : 789
|
# BELS : 599
|
||||||
# AND2 : 252
|
# AND2 : 193
|
||||||
# AND3 : 33
|
# AND3 : 18
|
||||||
# AND4 : 7
|
# AND4 : 7
|
||||||
# AND8 : 4
|
# AND8 : 3
|
||||||
# GND : 1
|
# GND : 1
|
||||||
# INV : 235
|
# INV : 189
|
||||||
# OR2 : 199
|
# OR2 : 146
|
||||||
# OR3 : 22
|
# OR3 : 22
|
||||||
# OR4 : 2
|
# OR4 : 2
|
||||||
# OR8 : 16
|
# OR8 : 16
|
||||||
# VCC : 1
|
# VCC : 1
|
||||||
# XOR2 : 17
|
# XOR2 : 1
|
||||||
# FlipFlops/Latches : 122
|
# FlipFlops/Latches : 105
|
||||||
# FD : 1
|
# FD : 1
|
||||||
# FDC : 26
|
# FDC : 25
|
||||||
# FDCE : 3
|
# FDCE : 3
|
||||||
# FDP : 42
|
# FDP : 42
|
||||||
# FDPE : 50
|
# FDPE : 34
|
||||||
# IO Buffers : 109
|
# IO Buffers : 109
|
||||||
# IBUF : 19
|
# IBUF : 19
|
||||||
# IOBUFE : 48
|
# IOBUFE : 48
|
||||||
@@ -413,14 +405,14 @@ Cell Usage :
|
|||||||
=========================================================================
|
=========================================================================
|
||||||
|
|
||||||
|
|
||||||
Total REAL time to Xst completion: 9.00 secs
|
Total REAL time to Xst completion: 8.00 secs
|
||||||
Total CPU time to Xst completion: 8.22 secs
|
Total CPU time to Xst completion: 8.40 secs
|
||||||
|
|
||||||
-->
|
-->
|
||||||
|
|
||||||
Total memory usage is 4534836 kilobytes
|
Total memory usage is 4534752 kilobytes
|
||||||
|
|
||||||
Number of errors : 0 ( 0 filtered)
|
Number of errors : 0 ( 0 filtered)
|
||||||
Number of warnings : 52 ( 0 filtered)
|
Number of warnings : 54 ( 0 filtered)
|
||||||
Number of infos : 10 ( 0 filtered)
|
Number of infos : 10 ( 0 filtered)
|
||||||
|
|
||||||
|
|||||||
+98
-222
@@ -1,197 +1,117 @@
|
|||||||
TS_CLK_EXT:FROM:DQ_DATA<8>.Q:TO:Z3_DATA<0>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<8>.Q:TO:Z3_DATA<0>.D:400
|
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<0>.Q:TO:Z3_DATA<0>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<0>.Q:TO:Z3_DATA<0>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<0>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<0>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<0>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<0>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<2>.Q:TO:Z3_DATA<10>.D:400
|
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<10>.Q:TO:Z3_DATA<10>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<10>.Q:TO:Z3_DATA<10>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<8>.Q:TO:Z3_DATA<10>.D:400
|
TS_CLK_EXT:FROM:LAN_D_INIT<8>.Q:TO:Z3_DATA<10>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<10>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<10>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<10>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<10>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<3>.Q:TO:Z3_DATA<11>.D:400
|
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<11>.Q:TO:Z3_DATA<11>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<11>.Q:TO:Z3_DATA<11>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<8>.Q:TO:Z3_DATA<11>.D:400
|
TS_CLK_EXT:FROM:LAN_D_INIT<8>.Q:TO:Z3_DATA<11>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<11>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<11>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<11>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<11>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<4>.Q:TO:Z3_DATA<12>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<1>.Q:TO:Z3_DATA<12>.D:400
|
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<12>.Q:TO:Z3_DATA<12>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<12>.Q:TO:Z3_DATA<12>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<12>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<12>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<12>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<12>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<5>.Q:TO:Z3_DATA<13>.D:400
|
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<13>.Q:TO:Z3_DATA<13>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<13>.Q:TO:Z3_DATA<13>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<13>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<13>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<13>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<13>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<6>.Q:TO:Z3_DATA<14>.D:400
|
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<14>.Q:TO:Z3_DATA<14>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<14>.Q:TO:Z3_DATA<14>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<14>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<14>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<14>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<14>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<7>.Q:TO:Z3_DATA<15>.D:400
|
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<15>.Q:TO:Z3_DATA<15>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<15>.Q:TO:Z3_DATA<15>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<15>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<15>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<15>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<15>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<9>.Q:TO:Z3_DATA<1>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<1>.Q:TO:Z3_DATA<1>.D:400
|
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<1>.Q:TO:Z3_DATA<1>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<1>.Q:TO:Z3_DATA<1>.D:400
|
||||||
|
TS_CLK_EXT:FROM:LAN_D_INIT<1>.Q:TO:Z3_DATA<1>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<1>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<1>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<1>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<1>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<2>.Q:TO:Z3_DATA<2>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<2>.Q:TO:Z3_DATA<2>.D:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<10>.Q:TO:Z3_DATA<2>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<8>.Q:TO:Z3_DATA<2>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<2>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<2>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<2>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<2>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<3>.Q:TO:Z3_DATA<3>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<3>.Q:TO:Z3_DATA<3>.D:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<11>.Q:TO:Z3_DATA<3>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<8>.Q:TO:Z3_DATA<3>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<3>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<3>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<3>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<3>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<4>.Q:TO:Z3_DATA<4>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<4>.Q:TO:Z3_DATA<4>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<1>.Q:TO:Z3_DATA<4>.D:400
|
TS_CLK_EXT:FROM:LAN_D_INIT<1>.Q:TO:Z3_DATA<4>.D:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<12>.Q:TO:Z3_DATA<4>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<4>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<4>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<4>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<4>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<5>.Q:TO:Z3_DATA<5>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<5>.Q:TO:Z3_DATA<5>.D:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<13>.Q:TO:Z3_DATA<5>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<5>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<5>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<5>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<5>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<6>.Q:TO:Z3_DATA<6>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<6>.Q:TO:Z3_DATA<6>.D:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<14>.Q:TO:Z3_DATA<6>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<6>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<6>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<6>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<6>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<7>.Q:TO:Z3_DATA<7>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<7>.Q:TO:Z3_DATA<7>.D:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<15>.Q:TO:Z3_DATA<7>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<7>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<7>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<7>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<7>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<8>.Q:TO:Z3_DATA<8>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<8>.Q:TO:Z3_DATA<8>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<8>.Q:TO:Z3_DATA<8>.D:400
|
TS_CLK_EXT:FROM:LAN_D_INIT<8>.Q:TO:Z3_DATA<8>.D:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<0>.Q:TO:Z3_DATA<8>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<8>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<8>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<8>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<8>.CE:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<9>.Q:TO:Z3_DATA<9>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<9>.Q:TO:Z3_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_D_INIT<1>.Q:TO:Z3_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_D_INIT<1>.Q:TO:Z3_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<1>.Q:TO:Z3_DATA<9>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<9>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_DATA<9>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<9>.CE:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:Z3_DATA<9>.CE:400
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||||||
|
TS_CLK_EXT:FROM:Z3_DATA<25>.Q:TO:DQ_DATA<9>.D:400
|
||||||
|
TS_CLK_EXT:FROM:Dout1<1>.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:DQ_DATA<9>.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:DQ_DATA<9>.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd1.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd1.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd2.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd2.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd7.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd7.Q:TO:DQ_DATA<9>.D:400
|
||||||
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd10.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd10.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd11.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd11.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd8.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd8.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd9.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd9.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd4.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd4.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:DQ_DATA<9>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd6.Q:TO:DQ_DATA<9>.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd6.Q:TO:DQ_DATA<9>.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd12.Q:TO:DQ_DATA<9>.D:400
|
|
||||||
TS_CLK_EXT:FROM:Dout1<1>.Q:TO:DQ_DATA<9>.D:400
|
|
||||||
TS_CLK_EXT:FROM:Z3_DATA<25>.Q:TO:DQ_DATA<9>.D:400
|
|
||||||
TS_CLK_EXT:FROM:Z3_DATA<17>.Q:TO:DQ_DATA<9>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd3.Q:TO:DQ_DATA<9>.D:400
|
|
||||||
TS_CLK_EXT:FROM:Z3_DATA<1>.Q:TO:DQ_DATA<9>.D:400
|
|
||||||
TS_CLK_EXT:FROM:Z3_DATA<9>.Q:TO:DQ_DATA<9>.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:DQ_DATA<9>.SETF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:DQ_DATA<9>.SETF:400
|
||||||
TS_CLK_EXT:FROM:LAN_RST_SM_FSM_FFd2.Q:TO:LAN_WR_RST.D:400
|
TS_CLK_EXT:FROM:LAN_RST_SM_FSM_FFd2.Q:TO:LAN_WR_RST.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_RST_SM_FSM_FFd3.Q:TO:LAN_WR_RST.D:400
|
TS_CLK_EXT:FROM:LAN_RST_SM_FSM_FFd3.Q:TO:LAN_WR_RST.D:400
|
||||||
@@ -551,14 +431,10 @@ TS_CLK_EXT:FROM:LAN_SM_FSM_FFd11.Q:TO:LAN_RD_S.D:400
|
|||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd12.Q:TO:LAN_RD_S.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd12.Q:TO:LAN_RD_S.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:LAN_RD_S.RSTF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:LAN_RD_S.RSTF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd9.Q:TO:LAN_WRH_S.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd9.Q:TO:LAN_WRH_S.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd4.Q:TO:LAN_WRH_S.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd8.Q:TO:LAN_WRH_S.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd8.Q:TO:LAN_WRH_S.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd2.Q:TO:LAN_WRH_S.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:LAN_WRH_S.RSTF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:LAN_WRH_S.RSTF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd9.Q:TO:LAN_WRL_S.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd9.Q:TO:LAN_WRL_S.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd4.Q:TO:LAN_WRL_S.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd8.Q:TO:LAN_WRL_S.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd8.Q:TO:LAN_WRL_S.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd2.Q:TO:LAN_WRL_S.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:LAN_WRL_S.RSTF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:LAN_WRL_S.RSTF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd10.Q:TO:Z3_A_LOW.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd10.Q:TO:Z3_A_LOW.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd8.Q:TO:Z3_A_LOW.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd8.Q:TO:Z3_A_LOW.D:400
|
||||||
@@ -570,7 +446,7 @@ TS_CLK_EXT:FROM:LAN_SM_FSM_FFd7.Q:TO:Z3_A_LOW.D:400
|
|||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_A_LOW.RSTF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:Z3_A_LOW.RSTF:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd3.Q:TO:lan_rdy.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd3.Q:TO:lan_rdy.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd7.Q:TO:lan_rdy.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd7.Q:TO:lan_rdy.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd1.Q:TO:lan_rdy.D:400
|
|
||||||
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:lan_rdy.D:400
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd5.Q:TO:lan_rdy.D:400
|
||||||
|
TS_CLK_EXT:FROM:LAN_SM_FSM_FFd1.Q:TO:lan_rdy.D:400
|
||||||
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:lan_rdy.RSTF:400
|
TS_CLK_EXT:FROM:LAN_SM_RST.Q:TO:lan_rdy.RSTF:400
|
||||||
TS_CLK_EXT:FROM:AUTO_CONFIG_DONE_CYCLE.Q:TO:CFOUT_OBUF.D:400
|
TS_CLK_EXT:FROM:AUTO_CONFIG_DONE_CYCLE.Q:TO:CFOUT_OBUF.D:400
|
||||||
|
|||||||
@@ -244,7 +244,7 @@ begin
|
|||||||
end if;
|
end if;
|
||||||
|
|
||||||
--lan base
|
--lan base
|
||||||
if(Z3='1' and (D(15 downto 8) & A(23 downto 16)) = LAN_BASEADR and SHUT_UP='0' )then
|
if(Z3='1' and (D(15 downto 8) & A(23 downto 16)) = x"4000" and SHUT_UP='0' )then
|
||||||
if(A(14 downto 13)<"11")then
|
if(A(14 downto 13)<"11")then
|
||||||
dq_swap <= '1';
|
dq_swap <= '1';
|
||||||
end if;
|
end if;
|
||||||
@@ -279,7 +279,7 @@ begin
|
|||||||
lan_rst_gen: process (CLK_EXT)
|
lan_rst_gen: process (CLK_EXT)
|
||||||
begin
|
begin
|
||||||
if rising_edge(CLK_EXT) then
|
if rising_edge(CLK_EXT) then
|
||||||
if(FCS ='1' or reset = '0') then
|
if(FCS ='1' or reset = '0' or Z3_DS = '1') then
|
||||||
LAN_SM_RST <='1';
|
LAN_SM_RST <='1';
|
||||||
else
|
else
|
||||||
LAN_SM_RST <='0';
|
LAN_SM_RST <='0';
|
||||||
@@ -314,17 +314,17 @@ begin
|
|||||||
-- this is a quite complex thing for a cpld
|
-- this is a quite complex thing for a cpld
|
||||||
-- so I have to move this out of the cycle start condition and prepare it for every loop
|
-- so I have to move this out of the cycle start condition and prepare it for every loop
|
||||||
if(UDS='0' or LDS='0')then
|
if(UDS='0' or LDS='0')then
|
||||||
if(dq_swap='0') then
|
--if(dq_swap='0') then
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN(31 downto 16);
|
DQ_DATA(15 downto 0) <= Z3_DATA_IN(31 downto 16);
|
||||||
else
|
--else
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN(23 downto 16) & Z3_DATA_IN(31 downto 24);
|
-- DQ_DATA(15 downto 0) <= Z3_DATA_IN(23 downto 16) & Z3_DATA_IN(31 downto 24);
|
||||||
end if;
|
--end if;
|
||||||
else
|
else
|
||||||
if(dq_swap='0') then
|
--if(dq_swap='0') then
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN(15 downto 0);
|
DQ_DATA(15 downto 0) <= Z3_DATA_IN(15 downto 0);
|
||||||
else
|
--else
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN( 7 downto 0) & Z3_DATA_IN(15 downto 8);
|
-- DQ_DATA(15 downto 0) <= Z3_DATA_IN( 7 downto 0) & Z3_DATA_IN(15 downto 8);
|
||||||
end if;
|
--end if;
|
||||||
end if;
|
end if;
|
||||||
if(lan_adr = '1' and Z3_DS = '0' and Z3_ADR(15) = '0' )then --cycle start!
|
if(lan_adr = '1' and Z3_DS = '0' and Z3_ADR(15) = '0' )then --cycle start!
|
||||||
|
|
||||||
@@ -339,23 +339,10 @@ begin
|
|||||||
LAN_SM <= wait_read_lower;
|
LAN_SM <= wait_read_lower;
|
||||||
end if;
|
end if;
|
||||||
else
|
else
|
||||||
|
|
||||||
-- determine bushalf
|
-- determine bushalf
|
||||||
if(UDS='0' or LDS='0')then
|
if(UDS='0' or LDS='0')then
|
||||||
-- prepare the data for write
|
|
||||||
if(dq_swap='0') then
|
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN(31 downto 16);
|
|
||||||
else
|
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN(23 downto 16) & Z3_DATA_IN(31 downto 24);
|
|
||||||
end if;
|
|
||||||
LAN_SM <= start_write_upper;
|
LAN_SM <= start_write_upper;
|
||||||
else
|
else
|
||||||
-- prepare the data for write
|
|
||||||
if(dq_swap='0') then
|
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN(15 downto 0);
|
|
||||||
else
|
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN( 7 downto 0) & Z3_DATA_IN(15 downto 8);
|
|
||||||
end if;
|
|
||||||
Z3_A_LOW <= '1';
|
Z3_A_LOW <= '1';
|
||||||
LAN_SM <= start_write_lower;
|
LAN_SM <= start_write_lower;
|
||||||
end if;
|
end if;
|
||||||
@@ -369,11 +356,11 @@ begin
|
|||||||
LAN_SM<=end_read_upper;
|
LAN_SM<=end_read_upper;
|
||||||
when end_read_upper=>
|
when end_read_upper=>
|
||||||
--fetch data
|
--fetch data
|
||||||
if(dq_swap='0') then
|
--if(dq_swap='0') then
|
||||||
Z3_DATA(31 downto 16) <= DQ;
|
Z3_DATA(31 downto 16) <= DQ;
|
||||||
else
|
--else
|
||||||
Z3_DATA(31 downto 16) <= DQ(7 downto 0) & DQ(15 downto 8);
|
-- Z3_DATA(31 downto 16) <= DQ(7 downto 0) & DQ(15 downto 8);
|
||||||
end if;
|
--end if;
|
||||||
if(DS1='1' and DS0='1')then -- no lower half
|
if(DS1='1' and DS0='1')then -- no lower half
|
||||||
lan_rdy <='1';
|
lan_rdy <='1';
|
||||||
LAN_SM <= end_read_upper; -- stay here until cylce end
|
LAN_SM <= end_read_upper; -- stay here until cylce end
|
||||||
@@ -391,11 +378,11 @@ begin
|
|||||||
LAN_SM<=end_read_lower;
|
LAN_SM<=end_read_lower;
|
||||||
when end_read_lower=>
|
when end_read_lower=>
|
||||||
--fetch data
|
--fetch data
|
||||||
if(dq_swap='0') then
|
--if(dq_swap='0') then
|
||||||
Z3_DATA(15 downto 0) <= DQ;
|
Z3_DATA(15 downto 0) <= DQ;
|
||||||
else
|
--else
|
||||||
Z3_DATA(15 downto 0) <= DQ(7 downto 0) & DQ(15 downto 8);
|
-- Z3_DATA(15 downto 0) <= DQ(7 downto 0) & DQ(15 downto 8);
|
||||||
end if;
|
--end if;
|
||||||
lan_rdy <='1';
|
lan_rdy <='1';
|
||||||
LAN_SM<=end_read_lower; -- stay here until cylce end
|
LAN_SM<=end_read_lower; -- stay here until cylce end
|
||||||
when start_write_upper=>
|
when start_write_upper=>
|
||||||
@@ -404,17 +391,14 @@ begin
|
|||||||
LAN_WRL_S <= not UDS;
|
LAN_WRL_S <= not UDS;
|
||||||
LAN_SM <= wait_write_upper;
|
LAN_SM <= wait_write_upper;
|
||||||
when wait_write_upper=>
|
when wait_write_upper=>
|
||||||
-- swapped LDS/UDS here: ENC624 is little endian
|
|
||||||
LAN_WRH_S <= not LDS;
|
|
||||||
LAN_WRL_S <= not UDS;
|
|
||||||
LAN_SM<=end_write_upper;
|
LAN_SM<=end_write_upper;
|
||||||
when end_write_upper=>
|
when end_write_upper=>
|
||||||
-- prepare the data for write
|
-- prepare the data for write
|
||||||
if(dq_swap='0') then
|
--if(dq_swap='0') then
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN(15 downto 0);
|
DQ_DATA(15 downto 0) <= Z3_DATA_IN(15 downto 0);
|
||||||
else
|
--else
|
||||||
DQ_DATA(15 downto 0) <= Z3_DATA_IN(7 downto 0) & Z3_DATA_IN(15 downto 8);
|
-- DQ_DATA(15 downto 0) <= Z3_DATA_IN(7 downto 0) & Z3_DATA_IN(15 downto 8);
|
||||||
end if;
|
--end if;
|
||||||
|
|
||||||
if(DS1='1' and DS0='1')then -- no lower half
|
if(DS1='1' and DS0='1')then -- no lower half
|
||||||
lan_rdy <='1';
|
lan_rdy <='1';
|
||||||
@@ -431,9 +415,6 @@ begin
|
|||||||
LAN_SM <= wait_write_lower;
|
LAN_SM <= wait_write_lower;
|
||||||
when wait_write_lower=>
|
when wait_write_lower=>
|
||||||
Z3_A_LOW <= '1';
|
Z3_A_LOW <= '1';
|
||||||
-- swapped DS0/DS1 here: ENC624 is little endian
|
|
||||||
LAN_WRH_S <= not DS0;
|
|
||||||
LAN_WRL_S <= not DS1;
|
|
||||||
LAN_SM<=end_write_lower;
|
LAN_SM<=end_write_lower;
|
||||||
when end_write_lower=>
|
when end_write_lower=>
|
||||||
lan_rdy <='1';
|
lan_rdy <='1';
|
||||||
|
|||||||
+4550
-6463
File diff suppressed because it is too large
Load Diff
File diff suppressed because one or more lines are too long
File diff suppressed because it is too large
Load Diff
File diff suppressed because it is too large
Load Diff
+1211
-1767
File diff suppressed because it is too large
Load Diff
@@ -30,7 +30,7 @@
|
|||||||
<tr>
|
<tr>
|
||||||
<td width="40%"> <b>Date</b>
|
<td width="40%"> <b>Date</b>
|
||||||
</td>
|
</td>
|
||||||
<td width="60%"> 12-17-2018, 10:59PM</td>
|
<td width="60%"> 12-17-2018, 11:55PM</td>
|
||||||
</tr>
|
</tr>
|
||||||
</table></span><br><span id="sumres" class="pgRef"><h5 align="center">RESOURCES SUMMARY</h5>
|
</table></span><br><span id="sumres" class="pgRef"><h5 align="center">RESOURCES SUMMARY</h5>
|
||||||
<table align="center" width="90%" border="1" cellspacing="0" cellpadding="0">
|
<table align="center" width="90%" border="1" cellspacing="0" cellpadding="0">
|
||||||
@@ -42,11 +42,11 @@
|
|||||||
<th width="20%">Function Block Inputs Used</th>
|
<th width="20%">Function Block Inputs Used</th>
|
||||||
</tr>
|
</tr>
|
||||||
<tr>
|
<tr>
|
||||||
<td width="20%" align="center">216/288 (75%)</td>
|
<td width="20%" align="center">192/288 (67%)</td>
|
||||||
<td width="20%" align="center">610/1440 (43%)</td>
|
<td width="20%" align="center">453/1440 (32%)</td>
|
||||||
<td width="20%" align="center">122/288 (43%)</td>
|
<td width="20%" align="center">105/288 (37%)</td>
|
||||||
<td width="20%" align="center">109/117 (94%)</td>
|
<td width="20%" align="center">109/117 (94%)</td>
|
||||||
<td width="20%" align="center">426/864 (50%)</td>
|
<td width="20%" align="center">359/864 (42%)</td>
|
||||||
</tr>
|
</tr>
|
||||||
</table></span><br><span id="pinres" class="pgRef"><h5 align="center">PIN RESOURCES</h5>
|
</table></span><br><span id="pinres" class="pgRef"><h5 align="center">PIN RESOURCES</h5>
|
||||||
<table align="center" width="90%" border="0" cellspacing="0" cellpadding="0"><tr>
|
<table align="center" width="90%" border="0" cellspacing="0" cellpadding="0"><tr>
|
||||||
@@ -123,7 +123,7 @@
|
|||||||
<table align="center" width="90%" border="1" cellspacing="0" cellpadding="0">
|
<table align="center" width="90%" border="1" cellspacing="0" cellpadding="0">
|
||||||
<tr>
|
<tr>
|
||||||
<td width="50%"> Macrocells in high performance mode (MCHP)</td>
|
<td width="50%"> Macrocells in high performance mode (MCHP)</td>
|
||||||
<td width="50%"> 216</td>
|
<td width="50%"> 192</td>
|
||||||
</tr>
|
</tr>
|
||||||
<tr>
|
<tr>
|
||||||
<td width="50%"> Macrocells in low power mode (MCLP)</td>
|
<td width="50%"> Macrocells in low power mode (MCLP)</td>
|
||||||
@@ -131,7 +131,7 @@
|
|||||||
</tr>
|
</tr>
|
||||||
<tr>
|
<tr>
|
||||||
<td width="50%"> Total macrocells used (MC)</td>
|
<td width="50%"> Total macrocells used (MC)</td>
|
||||||
<td width="50%"> 216</td>
|
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Release 8.1i - Fit P.20131013
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Release 8.1i - Fit P.20131013
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Copyright(c) 1995-2003 Xilinx Inc. All rights reserved
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Copyright(c) 1995-2003 Xilinx Inc. All rights reserved
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12-17-2018 10:59PM
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12-17-2018 11:55PM
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|
<TR ALIGN=LEFT><TD><A HREF_DISABLED='C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE\LAN_IDE_CP.bld'>Translation Report</A></TD><TD>Current</TD><TD>Mo 17. Dez 23:54:58 2018</TD><TD ALIGN=LEFT>0</TD><TD ALIGN=LEFT><A HREF_DISABLED='C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE\_xmsgs/ngdbuild.xmsgs?&DataKey=Warning'>1 Warning (0 new)</A></TD><TD ALIGN=LEFT COLSPAN='2'>0</TD></TR>
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<TR ALIGN=LEFT><TD><A HREF_DISABLED='C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE\LAN_IDE_CP.rpt'>CPLD Fitter Report (Text)</A></TD><TD>Out of Date</TD><TD>Mo 17. Dez 22:58:02 2018</TD><TD ALIGN=LEFT>0</TD><TD ALIGN=LEFT><A HREF_DISABLED='C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE\_xmsgs/cpldfit.xmsgs?&DataKey=Warning'>8 Warnings (1 new)</A></TD><TD ALIGN=LEFT COLSPAN='2'><A HREF_DISABLED='C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE\_xmsgs/cpldfit.xmsgs?&DataKey=Info'>1 Info (1 new)</A></TD></TR>
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<TR ALIGN=LEFT><TD><A HREF_DISABLED='C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE\LAN_IDE_CP.rpt'>CPLD Fitter Report (Text)</A></TD><TD>Out of Date</TD><TD>Mo 17. Dez 23:51:08 2018</TD><TD ALIGN=LEFT>0</TD><TD ALIGN=LEFT><A HREF_DISABLED='C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE\_xmsgs/cpldfit.xmsgs?&DataKey=Warning'>8 Warnings (1 new)</A></TD><TD ALIGN=LEFT COLSPAN='2'><A HREF_DISABLED='C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE\_xmsgs/cpldfit.xmsgs?&DataKey=Info'>1 Info (1 new)</A></TD></TR>
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<TR ALIGN=LEFT><TD>Power Report</TD><TD> </TD><TD> </TD><TD> </TD><TD> </TD><TD COLSPAN='2'> </TD></TR>
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@@ -77,5 +77,5 @@ System Settings</A>
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@@ -5,7 +5,7 @@
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@@ -94,10 +93,9 @@
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|
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@@ -116,22 +114,22 @@
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<item dataType="int" stringID="XST_FDPE" value="34"/>
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</item>
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</item>
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<item dataType="int" stringID="XST_IO_BUFFERS" value="109">
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<item dataType="int" stringID="XST_IO_BUFFERS" value="109">
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<item dataType="int" stringID="XST_IBUF" value="19"/>
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<item dataType="int" stringID="XST_IBUF" value="19"/>
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@@ -141,7 +139,7 @@
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</section>
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</section>
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<section stringID="XST_ERRORS_STATISTICS">
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<section stringID="XST_ERRORS_STATISTICS">
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<item dataType="int" filtered="0" stringID="XST_NUMBER_OF_ERRORS" value="0"/>
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<item dataType="int" filtered="0" stringID="XST_NUMBER_OF_ERRORS" value="0"/>
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<item dataType="int" filtered="0" stringID="XST_NUMBER_OF_WARNINGS" value="52"/>
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<item dataType="int" filtered="0" stringID="XST_NUMBER_OF_WARNINGS" value="54"/>
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<item dataType="int" filtered="0" stringID="XST_NUMBER_OF_INFOS" value="10"/>
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<item dataType="int" filtered="0" stringID="XST_NUMBER_OF_INFOS" value="10"/>
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</section>
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</section>
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</application>
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</application>
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@@ -1,2 +1,2 @@
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C:\Users\Matze\Amiga\Hardwarehacks\Zorro-LAN-IDE\Logic\LAN_IDE\LAN_IDE_CP.ngc 1545083930
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C:\Users\Matze\Amiga\Hardwarehacks\Zorro-LAN-IDE\Logic\LAN_IDE\LAN_IDE_CP.ngc 1545087290
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OK
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OK
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@@ -5,7 +5,7 @@
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behavior or data corruption. It is strongly advised that
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behavior or data corruption. It is strongly advised that
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users do not edit the contents of this file. -->
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users do not edit the contents of this file. -->
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<messages>
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<messages>
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<msg type="warning" file="Xst" num="819" delta="new" >"<arg fmt="%s" index="1">C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd</arg>" line <arg fmt="%d" index="2">291</arg>: One or more signals are missing in the process sensitivity list. To enable synthesis of FPGA/CPLD hardware, XST will assume that all necessary signals are present in the sensitivity list. Please note that the result of the synthesis may differ from the initial design specification. The missing signals are:
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<msg type="warning" file="Xst" num="819" delta="old" >"<arg fmt="%s" index="1">C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd</arg>" line <arg fmt="%d" index="2">291</arg>: One or more signals are missing in the process sensitivity list. To enable synthesis of FPGA/CPLD hardware, XST will assume that all necessary signals are present in the sensitivity list. Please note that the result of the synthesis may differ from the initial design specification. The missing signals are:
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<arg fmt="%s" index="3"><LAN_SM_RST></arg>
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<arg fmt="%s" index="3"><LAN_SM_RST></arg>
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</msg>
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</msg>
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@@ -51,6 +51,12 @@
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<msg type="warning" file="Xst" num="647" delta="old" >Input <<arg fmt="%s" index="1">C1</arg>> is never used. This port will be preserved and left unconnected if it belongs to a top-level block or it belongs to a sub-block and the hierarchy of this sub-block is preserved.
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<msg type="warning" file="Xst" num="647" delta="old" >Input <<arg fmt="%s" index="1">C1</arg>> is never used. This port will be preserved and left unconnected if it belongs to a top-level block or it belongs to a sub-block and the hierarchy of this sub-block is preserved.
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</msg>
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</msg>
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<msg type="warning" file="Xst" num="646" delta="old" >Signal <<arg fmt="%s" index="1">dq_swap</arg>> is assigned but never used. This unconnected signal will be trimmed during the optimization process.
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</msg>
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<msg type="warning" file="Xst" num="646" delta="old" >Signal <<arg fmt="%s" index="1">LAN_BASEADR</arg>> is assigned but never used. This unconnected signal will be trimmed during the optimization process.
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</msg>
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<msg type="info" file="Xst" num="1799" delta="old" >State <arg fmt="%s" index="1">start_read_upper</arg> is never reached in FSM <<arg fmt="%s" index="2">LAN_SM</arg>>.
|
<msg type="info" file="Xst" num="1799" delta="old" >State <arg fmt="%s" index="1">start_read_upper</arg> is never reached in FSM <<arg fmt="%s" index="2">LAN_SM</arg>>.
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</msg>
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</msg>
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+450
-1414
File diff suppressed because it is too large
Load Diff
@@ -3,7 +3,7 @@
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<!--The data in this file is primarily intended for consumption by Xilinx tools.
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<!--The data in this file is primarily intended for consumption by Xilinx tools.
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The structure and the elements are likely to change over the next few releases.
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The structure and the elements are likely to change over the next few releases.
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This means code written to parse this file will need to be revisited each subsequent release.-->
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This means code written to parse this file will need to be revisited each subsequent release.-->
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<application name="pn" timeStamp="Mon Dec 17 22:58:41 2018">
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<application name="pn" timeStamp="Mon Dec 17 23:54:41 2018">
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<section name="Project Information" visible="false">
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<section name="Project Information" visible="false">
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<property name="ProjectID" value="0" type="project"/>
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<property name="ProjectID" value="0" type="project"/>
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<property name="ProjectIteration" value="0" type="project"/>
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<property name="ProjectIteration" value="0" type="project"/>
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Binary file not shown.
@@ -1,2 +1,2 @@
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AR lan_ide_cp behavioral C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd sub00/vhpl01 1545083923
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AR lan_ide_cp behavioral C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd sub00/vhpl01 1545087283
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EN lan_ide_cp NULL C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd sub00/vhpl00 1545083922
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EN lan_ide_cp NULL C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd sub00/vhpl00 1545087282
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@@ -1,9 +1,9 @@
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V3 3
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V3 3
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FL C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd 2018/12/17.22:58:40 P.20131013
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FL C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd 2018/12/17.23:54:40 P.20131013
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EN work/LAN_IDE_CP 1545083922 \
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EN work/LAN_IDE_CP 1545087282 \
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FL C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd \
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FL C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd \
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PB ieee/std_logic_1164 1381692176 PB ieee/std_logic_arith 1381692177 \
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PB ieee/std_logic_1164 1381692176 PB ieee/std_logic_arith 1381692177 \
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PB ieee/STD_LOGIC_UNSIGNED 1381692179
|
PB ieee/STD_LOGIC_UNSIGNED 1381692179
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AR work/LAN_IDE_CP/Behavioral 1545083923 \
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AR work/LAN_IDE_CP/Behavioral 1545087283 \
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FL C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd \
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FL C:/Users/Matze/Amiga/Hardwarehacks/Zorro-LAN-IDE/Logic/LAN_IDE/LAN_IDE_CP.vhd \
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EN work/LAN_IDE_CP 1545083922
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EN work/LAN_IDE_CP 1545087282
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Binary file not shown.
Binary file not shown.
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